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紐瑞芯

版圖設(shè)計(jì)工程師

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  • 12萬-24萬/年
  • 深圳
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  • 工作經(jīng)驗(yàn)不限
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  • 全職

職位誘惑: 五險(xiǎn)一金,福利好,老板nice,十五薪,技術(shù)領(lǐng)先,成長(zhǎng)空間大

發(fā)布時(shí)間: 2018-10-29發(fā)布

職位描述

職位信息
1.      協(xié)助設(shè)計(jì)工程師完成芯片版圖布局
2.     根據(jù)芯片的布局,設(shè)計(jì)模塊的內(nèi)部布局并完成模塊的版圖設(shè)計(jì)
3.     獨(dú)立完成芯片模塊設(shè)計(jì),Top Layout連線
4.     按照設(shè)計(jì)工程師的要求設(shè)計(jì)IC版圖,包括信號(hào)走線,電阻及晶體管的匹配,大電流走線,ESD器件,Latch up rule等方面的考慮
5.     完成DRC/LVS驗(yàn)證及XRC抽取
6.     做好DRC、LVS、LVL、GDS、NETLIST、SCHEMATIC及LAYOUT 數(shù)據(jù)檢查及備份,確保送出去的數(shù)據(jù)準(zhǔn)備無誤
任職要求
1.      大專及以上學(xué)歷,微電子/電子工程/版圖設(shè)計(jì) 相關(guān)專業(yè)優(yōu)先
2.     layout工作經(jīng)驗(yàn)1年以上,有過版圖工作設(shè)計(jì)經(jīng)驗(yàn)優(yōu)先
3.     熟悉Linux/Unix操作系統(tǒng),掌握virtuoso、calibre等版圖工具的使用
4.     熟練使用Calibre進(jìn)行drc/lvs/xrc驗(yàn)證
5.     理解 匹配/ESD/latch up/天線效應(yīng) 原理
6.     對(duì)CMOS工藝制程有一定了解
良好的溝通及團(tuán)隊(duì)合作能力,具有較強(qiáng)的抗壓能力

職位發(fā)布者

深圳市紐瑞芯科技有限公司

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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