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沃瑞咨詢【專業(yè)半導(dǎo)體獵頭】

Digital FE Design Engineer

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  • 20萬-30萬/年
  • 上海
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  • 1-3年
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職位誘惑: 成長空間大,十五薪,福利好,技術(shù)領(lǐng)先

發(fā)布時間: 2020-04-02發(fā)布

職位描述

JOB DESCRIPTION:
1. Build SoC/IP level Spyglass/Synthesis/Timing Analysis/Formality Check/CDC flow
2. Do SoC/IP level synthesis / timing analysis / formality check / CDC check
3. Deliver constraints and closely co-work timing closure with P&R 
4. Take some block level RTL coding 
 
QUALIFICATION:
1. MSEE with ＞3 year+ experience of digital design experience;
2. Relevant experience in complex timing closure;
3. Be familiar with DC/PT/formality check tools 
4. Be familiar with Tcl/Perl/…. Scripts language
5. RTL coding experience is a plus

職位發(fā)布者

Roger Tang 湯馮喆

Recruitment Expert

7天

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領(lǐng)域: 移動手持,消費電子

規(guī)模: 100-200人

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工作地址:

浦西

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