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職位誘惑: 年終獎(jiǎng)金,五險(xiǎn)一金,福利好,老板nice,節(jié)日禮物

發(fā)布時(shí)間: 2019-11-06發(fā)布

職位描述

崗位職責(zé):
1. 負(fù)責(zé)數(shù)字前端設(shè)計(jì)工作;
2. 能夠獨(dú)立分析數(shù)字電路功能/性能和競(jìng)爭(zhēng)力;
3. 能夠獨(dú)立分析模擬電路性能和接口設(shè)計(jì);
4. 能夠獨(dú)立完成驗(yàn)證/測(cè)試Check List等芯片測(cè)試工作;
5. 負(fù)責(zé)與AE工程師協(xié)作進(jìn)行項(xiàng)目應(yīng)用開(kāi)發(fā)。
6 .完成技術(shù)文檔的編寫(xiě)。

崗位要求:
1、微電子、電子工程相關(guān)專(zhuān)業(yè),本科以上學(xué)歷;
2、熟悉Verilog HDL語(yǔ)言,熟悉ARM,AMBA總線(xiàn)及常用外設(shè)接口的原理;
3、熟悉常用的EDA工具(VCS,NCSIM, Verdi, Conformal, RC/DC, PT etc. );
4、具有ARM或者M(jìn)CU項(xiàng)目經(jīng)驗(yàn)者優(yōu)先;
5、熟悉SOC系統(tǒng)架構(gòu)及驗(yàn)證經(jīng)驗(yàn)者優(yōu)先;
6、具有良好的中英文閱讀、溝通和文檔寫(xiě)作能力;
7、主動(dòng)性強(qiáng),有責(zé)任心,做事認(rèn)真仔細(xì),良好的團(tuán)隊(duì)合作精神。
 

職位發(fā)布者

ISSI芯成半導(dǎo)體

HR

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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