- 21萬-35萬/年
- 成都
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- 3年以上
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- 本科
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- 全職
職位誘惑: 年終獎(jiǎng)金,六險(xiǎn)一金,十四薪,年度體檢,福利好,老板nice,股票期權(quán),天天下午茶,技術(shù)領(lǐng)先,成長(zhǎng)空間大,交通補(bǔ)助,節(jié)日禮物,技能培訓(xùn)
發(fā)布時(shí)間: 2019-06-11發(fā)布
職位描述
職位描述：
- 規(guī)劃SOC外設(shè)IP及子系統(tǒng)的FPGA驗(yàn)證方案；
- 負(fù)責(zé)SOC外設(shè)IP及子系統(tǒng)驗(yàn)證方案的FPGA綜合及實(shí)現(xiàn)；
- 配合ASIC IP設(shè)計(jì)團(tuán)隊(duì)完成相關(guān)IP的驗(yàn)證工作。
- 電子，計(jì)算機(jī)或自動(dòng)化專業(yè)本科以上學(xué)歷；
- 熟悉FPGA相關(guān)應(yīng)用知識(shí)，熟悉Xilinx FPGA設(shè)計(jì)工具，如ISE/Vivado；
- 熟悉VHDL語言，如verilog / system verilog等；
- 熟悉相關(guān)SOC外設(shè)IP，如MIPI / USB / SD /emmc / DDR等；
- 熟練使用調(diào)試儀器，如邏輯分析儀，示波器等；
- 有較強(qiáng)的溝通能力，學(xué)習(xí)能力和問題解決能力以及團(tuán)隊(duì)合作精神。
職位發(fā)布者
胡馨予
HR
7天
簡(jiǎn)歷處理用時(shí)
100%
簡(jiǎn)歷及時(shí)處理率
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