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Front-end Senior Engineer – Verilog RTL Design [北京] 2019-02-25發(fā)布25萬(wàn) - 50萬(wàn) 3年以上 | 本科及以上技術(shù)領(lǐng)先,成長(zhǎng)空間大,技能培訓(xùn),年底雙薪,年終獎(jiǎng)金,五險(xiǎn)一金 -
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